具有減低延遲、傾斜、串音之時脈繞線合成策略應用於多重時脈系統晶片之研究(I)

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題名:	具有減低延遲、傾斜、串音之時脈繞線合成策略應用於多重時脈系統晶片之研究(I)
其他題名:	Clock Routing Synthesized Strategies for Reducing Delay, Skew, and Crosstalk in Multi-Clock SoC(I)
作者:	蔡加春
貢獻者:	南華大學資訊工程學系
關鍵詞:	系統單晶片;時脈樹合成;時脈傾斜誤差;RLC延遲模型;串音
日期:	2005
上傳時間:	2011-03-10 10:51:08 (UTC+8)
顯示於類別:	[資訊工程學系] 國科會計畫

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